pfaure/Processeur
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Faure Paul 2022-06-27 21:48:05 +02:00
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Processeur.srcs/sources_1/new/System.vhd
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@ -137,7 +137,7 @@ architecture Structural of System is
signal clavier_STD_OUT_Av : STD_LOGIC := '0'; -- Sortie disponible depuis le Clavier signal clavier_STD_OUT_Av : STD_LOGIC := '0'; -- Sortie disponible depuis le Clavier
signal clavier_STD_OUT_Int : STD_LOGIC := '0'; -- Type de la sortie (entier ou ASCII) depuis le Clavier signal clavier_STD_OUT_Int : STD_LOGIC := '0'; -- Type de la sortie (entier ou ASCII) depuis le Clavier
constant SECURISED : boolean := false; -- Booléen de sélection entre la version sécurisée et non sécurisée constant SECURED : boolean := true; -- Booléen de sélection entre la version sécurisée et non sécurisée
begin begin
@ -148,7 +148,7 @@ begin
-- Generation du pipeline en fonction de la condition sécurisé ou non -- Generation du pipeline en fonction de la condition sécurisé ou non
instance: if (SECURISED) generate instance: if (SECURED) generate
instance_securisee : entity work.Pipeline instance_securisee : entity work.Pipeline
generic map (Nb_bits => 16, generic map (Nb_bits => 16,
Instruction_En_Memoire_Size => 53, Instruction_En_Memoire_Size => 53,