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No EOL
2 KiB
C
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No EOL
2 KiB
C
#include <stm32f10x.h>
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#include <MySPI.h>
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#include <GPIO.h>
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void MySPI_Init(SPI_TypeDef * SPI){
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if (SPI == SPI1) {
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RCC->APB2ENR |= RCC_APB2ENR_SPI1EN; // Enable horloge
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SPI->CR1 |= SPI_CR1_BR; // Mise FSCK a 281kHz pour SP1
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// Initialisationdes PORTS IOs
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MyGPIO_Init(GPIOA,4,Out_Ppull);
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MyGPIO_Init(GPIOA,5,AltOut_Ppull);
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MyGPIO_Init(GPIOA,6,In_Floating);
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MyGPIO_Init(GPIOA,7,AltOut_Ppull);
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}
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else if (SPI == SPI2) {
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RCC->APB2ENR |= RCC_APB1ENR_SPI2EN;
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SPI->CR1 |= SPI_CR1_BR_1 | SPI_CR1_BR_2;
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MyGPIO_Init(GPIOB,12,Out_Ppull);
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MyGPIO_Init(GPIOB,13,AltOut_Ppull);
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MyGPIO_Init(GPIOB,14,In_Floating);
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MyGPIO_Init(GPIOB,15,AltOut_Ppull);
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}
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SPI->CR1 |= SPI_CR1_CPOL; // Mettre le SCK a 1 au repose
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SPI->CR1 |= SPI_CR1_CPHA; // Mettre SCK en rising edge
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SPI->CR1 |= SPI_CR1_SSM; // NSS géré par software
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SPI->CR1 |= SPI_CR1_SSI; // pour permettre de gerer nss par software
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if (SPI == SPI1) MyGPIO_Set(GPIOA,4); // Met NSS a etat haut quand on est pas en transmission ou reception
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else if (SPI == SPI2) MyGPIO_Set(GPIOB,12);
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SPI->CR1 |= SPI_CR1_MSTR; // Mise en mode maitre du SPI
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SPI->CR1 |= SPI_CR1_SPE; // Enable SPI
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}
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void MySPI_Send(char ByteToSend){
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MySPI_Clear_NSS(); // Debut transmission
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while (!(SPI1->SR & SPI_SR_TXE)){} // Attend que DR soit vide
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SPI1->DR = ByteToSend; // On met notre donnée dans DR
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while (!(SPI1->SR & SPI_SR_RXNE)){} // Attente de réception du byte poubelle sur MISO
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char poubelle = SPI1->DR; // Je pense qu'on pourrait clear RXNE a la place : SPI1->SR &=~ SPI_SR_RXNE
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MySPI_Set_NSS(); // Fin transmission
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}
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char MySPI_Read(void){
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MySPI_Clear_NSS(); //Début transmission
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while (!(SPI1->SR & SPI_SR_TXE)){} // Attend que DR soit vide
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SPI1->DR = 0x00; // Pour trasmettre la clock
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while (!(SPI1->SR & SPI_SR_RXNE)) {} // On attend de recevoir dans buffer de reception le byte
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MySPI_Set_NSS(); // Fin transmission
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return SPI1->DR;
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}
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void MySPI_Set_NSS(void){
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MyGPIO_Set(GPIOA,4);
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}
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void MySPI_Clear_NSS(void){
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MyGPIO_Reset(GPIOA,4);
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} |